実習・Verilog HDLによるFPGA開発・設計入門

実習・Verilog HDLによるFPGA開発・設計入門
―― 論理回路の基礎から大規模回路の設計手法まで

  

【開催日】2020年9月3日(木) ~ 2020年9月4日(金) 10:00-17:00 2日コース
【セミナNo.】ES20-0078  【受講料】38,000円(税込)
【会場】東京・巣鴨 CQ出版社2Fセミナ・ルーム [地図]
セミナ会場

 1日目は,最初に論理(ディジタル)回路設計の基本(ブール代数,論理演算,論理回路,記憶回路)とVerilog HDL(ハードウエア記述言語)を学習する.その後,Intel社から無償で提供されたQuartus Prime開発環境(FPGA設計)とディジタル回路のキー・デバイスの一つであるFPGA(MAX 10)が実装されたトレーニング・ボードDE10-Liteを使い,FPGAにディジタル回路を書き込み,FPGAの基本的な使い方とディジタル回路設計を習得する.
 2日目は,大規模なディジタル回路を構築するときに必要となるタイミング制約(SDC),階層構造のディジタル回路をVerilog HDLで記述する方法,設計した回路動作をシミュレーションするためのModelSimの使い方を学習する.
 2日間でVerilog HDL設計,Quartus Prime開発環境,ModelSimシミュレーション手法に必要な知識やノウハウについて,実務経験豊富な講師が実習を取り入れながらていねいに解説する.

※ 実習で使用するパソコン,トレーニング・ボードは,CQ出版社が用意します.

※トレーニング・ボードDE10-Liteは,当日購入することができます.価格:13,000円(税込み),現金のみ.

●対象聴講者
・基本論理素子(AND,OR,NOT,FF)の基本動作を知っている方
・2進数,10進数,16進数を知っている方
・ブール代数について教科書などで学んだことがある方
・Windowsパソコンの基本操作ができる方
・C言語かアセンブリ言語を多少勉強したことがある方(望ましい)

●内容
1. ディジタル回路の基本設計を学習
2. Verilog HDLの基礎
 Quartus Primeを使いVerilog HDLでディジタル回路設計を行い,トレーニング・ボード上のFPGAに回路を書き込み,動作確認
3. ModelSimシミュレータ(Verilog HDL)の使い方を実習
4. Verilog HDLの実習
 4.1 組み合わせ回路
 4.2 順序回路
 4.3 タイミング制約(SDC)
 4.4 ステートマシン
 4.5 インスタンシェーション
 4.6 シミュレーション

本セミナで使用するFPGA(MAX10)が実装されたトレーニング・ボード(DE10-Lite)
本セミナで使用するFPGA(MAX 10)が実装されたトレーニング・ボードDE10-Lite

DE10-Liteの主な搭載部品
・FPGA(MAX10 10M50DAF484C7G)
・オンボードUSBブラスタ(オンボードでFPGA書き込み)
・SDRAM :64MB
・LED(10個)、7セグメントLED(6個)
・プッシュ・ボタン・スイッチ(2個)、スライド・スイッチ(10個)


【受講者が持参するもの】
USBメモリ(実習ファイル持ち帰り用,FAT32,4GB以上)

【講師】
萬代 慶昭 氏〔バンテクノ 〕
 1968年,東芝に入社.通信インターフェース装置のハードウェア設計などに従事.2003年,東芝を退職し,バンテクノを設立.マイコン組み込み装置に使われるFPGA設計の受託に従事.


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過去に受講された方のコメント

  • FPGA開発未経験で全般的なことを知りたかったので,入門として最適だった.資料も丁寧で,復習する際に役立ちそう.(30代,ソフト開発エンジニア)
  • 受講した目的は,FPGAを手を動かして理解することでした.教科書だけではやりきれない細かい実習もでき,満足です.(20代,学生)
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コース

 2日コース

カテゴリ

 回路・電子部品
 組み込みシステム

シリーズ

 ディジタル回路設計入門シリーズ

特徴

 演習あり
 実習

キーワード

 FPGA
 HDL
 コンピュータ
 シミュレータ
 プログラミング言語
 開発環境
 開発手法
 技術教育

セミナ事務局からのお知らせ

・オンラインセミナを始めました(2020/5/21).

キャンセルの規定が変わりました(2020/2/21).