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トランジスタ技術1月号で紹介している2018年2月14日開催のセミナ
「ピタリ1cm!新GPSスタートアップ」(仮題)のWebページは12月中旬に公開します.


直伝!最新FPGAを使ったビデオ・システムの開発・プラットフォーム構築編(MPSoC対応版)

直伝!最新FPGAを使ったビデオ・システムの開発・プラットフォーム構築編(MPSoC対応版)
―― 'あの最近話題の'激アツ'FPGAも恐れるに足らず!?実事例でそのツボを'即'キャッチアップ

 

【開催日】2017年10月17日(火) 10:00-17:30 1日コース
【セミナNo.】ES17-0119  【受講料】26,000円(税込)
【会場】アヴネット社 セミナールーム [地図]
セミナ会場

 近年,FPGAデバイスとその設計ツール環境のめざましい進化(性能向上,高機能・大規模化,ロー・コスト化)により,従来ASICで行っていた複雑なシステム・オン・チップ(SoC)の実現をデスクトップ上で手軽に実現できるようになってきた. 
 また,MPU等のIP(再利用可能設計済み回路)によるブロック・ベース設計手法や高位合成ツール(HLS)を適用することによりハードウェア設計の深い知識がなくてもオリジナル・チップを開発することが可能である.
 これらを活用するこによりIoTや高精細ビデオ(8K4K)等の現代のさまざまな市場要求を迅速に実現することができるようにもなる。
 本講座ではOnSemi社製イメージ・センサ(MT9P031)を搭載したATRJ社製イメージャ・モジュール(IMG-A500P)とXilinx社製Zynq UltraScale+ MPSoCデバイスを搭載したAvnet社製廉価MPSoCボード(UltraZED)を使用して,イメージャ入力からビデオ出力までの簡単なカメラ・システム構築を実例に'激アツ'FPGA(MPSoC)とその最新設計手法による'超'生産性システム開発フローのポイントを習得する.

1.'激アツ'FPGA基礎
 1.1 Zynq UltraScale+(MPSoC)とは?その特長
 1.2 従来のZynqデバイスとの違い・留意点(ペリフェラル,PSU-PL I/F等)
 1.3 ブロック・ベース設計手法
 1.4 高位合成の徳
2.開発環境概要
 2.1 設計ツール
 2.2 リファレンス・ボード
 2.3 おすすめドキュメント
 2.4 システム構成
3.システム構築準備
 3.1 データフロー・ビデオ・パイプライン
 3.2 チップ・アーキテクチャ
 3.3 色補間処理
4.システム構築実習
 4.0 ボード・ファイルのインストール
 4.1 ベース・ハードウェア・デザインの作成
 4.2 イメージ入出力処理サブ・システム(カスタムIPコア)の追加
 4.3 制御ソフトウェアの作成
 4.4 色補間処理のソフトウェア処理での実装
 4.5 色補間処理の高位合成によるハードウェア化とインテグレーション
5.質疑応答
※進行状況により内容が一部変更となることがあります.

実演で使用するAvnet社製廉価MPSoCボード(UltraZED)
実演で使用するAvnet社製廉価MPSoCボード(UltraZED)

同ボードにATRJ社製イメージャ・モジュール(IMG-A500P)をつないだようす
同ボードにATRJ社製イメージャ・モジュール(IMG-A500P)をつないだようす

●対象聴講者
・UltraScale+Zynqに興味のある方  
・C言語設計および非HDL設計に興味のある方 
・低コストで高精細ビデオ・システムを開発しようとしている方
・'卒'HDL設計に興味のある方
・FPGAに搭載されたMPUやペリフェラル・コントローラを活用したい方

●講演の目標
・ZynqからUltraScale+Zynq(MPSoC)への移行するための要点の理解
・ビデオ・システム基礎の理解
・FPGAのシステム・プラットフォームとしての応用方法の理解
・効率の良いハードウェア・ソフトウェア平行開発方法の理解


【受講者が持参するもの】
不要

【講師】
早乙女 勝昭 氏〔アドバンスド・テクノロジー・リサーチ・ジャパン合同会社 President & CXO 〕
 FPGAエバンジェリスト.FPGAマガジン#6,#10特集記事執筆.


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コース

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カテゴリ

 回路・電子部品
 組み込みシステム

シリーズ

 

特徴

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キーワード

 FPGA
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